Active-HDL Update 1共1篇
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电子设计自动化软件，用于FPGA和ASIC的仿真、综合与验证，支持VHDL和Verilog混合语言设计流程。支持VHDL/Verilog混合语言仿真提供波形查看与调试工具集成综合与设计验证环境当前版本：11.1
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热心网友的头像-360自学网热心网友6个月前
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