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面向FPGA与SoC设计的综合实现软件，用于RTL综合、布局布线、时序分析与比特流生成，支持工程行业硬件开发。
- RTL逻辑综合与优化
- 布局布线与物理实现
- 静态时序分析与约束验证
当前版本：2019.03
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